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ＳｙｓｔｅｍＶｅｒｉｌｏｇによるＦＰＧＡ／ディジタル回路設計入門

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書誌詳細

この資料の書誌詳細情報です。

タイトルコード 1000001041910
書誌種別 図書
著者名 小林和淑／監修
小林和淑／共著
出版者 ［オーム社（発売）］
出版年月 ２０２３．１１
ページ数 ８，１８３ｐ
大きさ ２４ｃｍ
ISBN 978-4-274-23101-8
分類記号 549.7
書名 ＳｙｓｔｅｍＶｅｒｉｌｏｇによるＦＰＧＡ／ディジタル回路設計入門　
書名ヨミ システム　ヴェリログ　ニ　ヨル　エフピージーエー　ディジタル　カイロ　セッケイ　ニュウモン
内容紹介 ＨＤＬは、高い抽象度でハードウェアの動作を記述することを目的に開発された。順序同期回路をＳｙｓｔｅｍＶｅｒｉｌｏｇで記述し、ＬＳＩやＦＰＧＡに実装したい設計者向けに、設計事例をもとに解説する。
件名1 集積回路
件名2 ハードウェア記述言語


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No. 所蔵館資料番号請求記号配架場所帯出区分状態 貸出
1 県立図010624203549.1/113/ 一般開架帯出可在庫 ○
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